下面是有关DRAM和SRAM存储器芯片的叙述： I．DRAM芯片的集成度比SRAM高 Ⅱ．DRAM芯片的成本比SRAM高 Ⅲ．DRAM芯片的速度比SRAM快 Ⅳ．DRAM芯片工作时需要刷新，SRAM芯片工作时不需要刷新

admin2019-12-10 70

问题下面是有关DRAM和SRAM存储器芯片的叙述：
I．DRAM芯片的集成度比SRAM高
Ⅱ．DRAM芯片的成本比SRAM高
Ⅲ．DRAM芯片的速度比SRAM快
Ⅳ．DRAM芯片工作时需要刷新，SRAM芯片工作时不需要刷新
通常情况下，错误的是( )。

选项 A、I和Ⅱ
B、Ⅱ和Ⅲ
C、Ⅲ和Ⅳ
D、I和Ⅳ

答案B

解析 DRAM的集成度高于SRAM，SRAM的速度高于DRAM，可以推出DRAM的成本低于SRAM，SRAM 芯片工作时不需要刷新，DRAM芯片工作时需要刷新。随机存储器RAM又可分为静态RAM(SRAM)和动态RAM(DRAM)两种。SRAM由6个MOS管组成一个记忆单元，它的存取速度快，但集成度低，功耗也较大；DRAM由4个MOS管或单个MOS管组成一个记忆单元，它的集成度高，功耗小，但存取速度慢。DRAM是靠MOS电路中的栅极电容来存储信息的，栅极电容上的电荷数目会随着时间推移逐步泄漏，因此每隔一定的时间必须向栅极电容补充一次电荷，这个过程称为“刷新”。

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下面是有关DRAM和SRAM存储器芯片的叙述： I．DRAM芯片的集成度比SRAM高 Ⅱ．DRAM芯片的成本比SRAM高 Ⅲ．DRAM芯片的速度比SRAM快 Ⅳ．DRAM芯片工作时需要刷新，SRAM芯片工作时不需要刷新

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既考虑作业等待时间又考虑作业执行时间的调度算法是()。

一个UDP用户的数据报的数据部分长为8192字节。那么通过以太网来传播该UDP数据报时，最后一个IP分片的数据长度是()。

分时系统里，在条件相同的情况下，通常KLT(内核级线程)比ULT(用户级线程)得到更多的CPU时间，请简要解释之。

快速排序最易发挥其长处的情况是()。

某计算机系统的内存储器由Cache和主存构成，Cache的存取周期为45纳秒，主存的存取周期为200纳秒。已知在一段给定的时间内，CPU共访问内存4500次，其中340次访问主存。问：(1)Cache的命中率是多少?(2)CPU访问内存的平均

四位运算器框图如下图所示，ALU为算术逻辑单元，A和B为三选一多路开关，预先已通过多路开关A的SW门向寄存器R1，R2送入数据如下：R1=0101，R2=1010。寄存器BR输出端接四个发光二极管进行显示。其运算过程依次如下：(1)R1

下列关于二叉树的说法中，正确的是()。

假设程序PA和PB单独执行时所需的时间分别用TA和TB表示，并且假设TA=1h，TB=1．5h，其中处理器工作时间分别为TA=18min，TB=27min，如果采用多道程序设计方法，让PA和PB并行工作，假定处理器利用率达到50％，系统开销为15

适用于在生产技术、工艺和营销方面具有优势，但在生产制造方面缺乏成本优势的企业的国外生产的是()

系统性红斑狼疮瘤型麻风

根据《律师事务所从事证券法律业务管理办法》对律师事务所从事证券业务的规定，下列说法正确的有(　　)。

安全生产管理的核心是()。

下列各项中，会导致企业采取低股利政策的事项有()。

鼓励老年人适当的参加社会活动，与他人保持必要地沟通，最重要的原因是沟通能()。

下列句子没有语病的一项是()。

行政合理性原则的具体要求有（）。

选项四个图形中，只有一个是由题干四个图形拼合而成的，请选出来。

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既考虑作业等待时间又考虑作业执行时间的调度算法是()。

一个UDP用户的数据报的数据部分长为8192字节。那么通过以太网来传播该UDP数据报时，最后一个IP分片的数据长度是()。

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假设程序PA和PB单独执行时所需的时间分别用TA和TB表示，并且假设TA=1h，TB=1．5h，其中处理器工作时间分别为TA=18min，TB=27min，如果采用多道程序设计方法，让PA和PB并行工作，假定处理器利用率达到50％，系统开销为15

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